3bit ripple carry adder 라는 게 있다. 이게 하는 역할은 3bit짜리 2`s complement 값을 인자로 받아 두개의 합을 3 bit 의 result와 그에 대한 carry를 나타내는 논리 회로다. 생긴건 위와 같이 생겼다. 말속에 adder라는 말이 들어있다시피 여러 개의 full adder를 합쳐서 만들게 된다. 그래서 위의 회로를 full adder로 풀어쓰게 되면 다음과 같은 그림이 된다. 결국 3 bit ripple carry adder를 설계하려면 1 bit full adder를 설계할 수 있어야 한다. 지난 포스트 중에 mux를 활용해서 2 bit adder / subtractor를 만들어봤었는데, 이번에는 단순히 Full Adder만을 활용한 3bit ripple c..
아무래도 instruction을 fetch하고 decode하는 과정에서 필요한 요소중 하나가 mux다. 이 mux에서 나온 결과를 활용해서 alu에 어떤 결과를 전달하냐를 결정하기 때문이다. 또한 이걸 활용해서 어떤 register에 저장하겠냐를 결정할 수 있기 때문에 최종적으로는 register file을 구현하는데 이용한다. 아래가 1bit짜리 8-to-1 mux를 구현한 것이다. 사실 원리 자체는 심플하다. select 3bit의 값에 따라서 어떤 입력으로 들어왔는지 판단만 한후 내보내주면 되기 때문이다. 아마 눈치빠른 사람이면 알겠지만 기본적으로 select bit만큼 2의 지수를 적용한 값이 입력의 갯수가 되겠다. 따라서 이와 비슷한 mux로는 아주 간단한 2-to-1 이나 많게는 32-to-5..
이제 강의를 듣는 부분은 Finite State Machine이다. 말그대로 State가 유한개 존재하면서 특정상황에 어떤 입력이 들어오느냐에 따라 state와 output을 변화시키는 시스템이다. 사실 일전에 Tiva C Launchpad에 구현도 한번 한 내용이다. 한번 궁금한 사람은 밑의 링크를 참조해보길...2014/03/30 - [About MOOC] - TrafficLight Simulation아무튼 Finite State Machine을 설계하는데 원칙이 몇가지가 있다. 물론 내가 생각한게 아니라 강의 내용을 번역에서 갖고 오자면.1) 현재 당면 문제를 상기하고, 주어진 것 중 입력과 출력이 뭔지를 구별해야 한다.2) 문제를 상기하고 어떤 state가 필요한지를 고려하고 그에 따른 state..
Register는 보통 D-FlipFlop으로 만든다. 여기에 공용되는 CLK line을 따서 각각의 입력과 출력을 연결시켜주면 완성된다. 사진의 예시는 12bit register를 만든 것이다. 그런데 register가 이렇게 일방적으로 쓰기만 하는 register가 아닌 특정 bit값에 따라 읽고 쓰기에 제한이 있는 register가 있는데 보통 loadable register라고 한다. 참고로 위의 네모처진 부분은 MUX다. 그래서 LD값의 입력에 따라서 이전에 FlipFlop에 들어있는 값이 읽히거나 혹은 DATA로 들어가는 입력이 Q값으로 나오게 되는 것이다. 역시 이걸 이용해서 16bit register를 만드는 것도 맨처음 그림과 같다. 단 차이가 있다면 위에서 만든 LD 를 넣는 입력이 고..
요즘 이전 전공을 살려서 회로이론 책을 검토해주고 있습니다. 전자과 출신이라면 아마 누구나 다 사용하셨을 법한 Pspice 입니다. 요즘에는 Orcad 제품군으로 들어가서 간단한 회로에 대한 시뮬레이션을 진행할 수 있습니다. 물론 회사에 가시면 이거보다 더 정밀한 결과를 낼 수 있는 툴이 있습니다. 저같은 경우는 운 좋게도 학부연구생을 할때 잠깐 Cadence IC 610을 다뤄봤습니다. 뭐 그래도 기본적인 전자캐드 프로그램은 UI가 비슷비슷 한듯 합니다. 아무튼 학부에 있다면 Pspice로도 충분히 원하는 결과를 얻으실 수 있고, 그에 대한 예상 시뮬레이션을 뽑을 수 있습니다. 우선 회로를 그릴 수 있는 툴인 Schematics입니다. 사실 이 프로그램은 오래 전에 나온 프로그램이라 windows7에서..
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